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(HDL을 이용한) SoC 및 IP 설계기법/
(HDL을 이용한) SoC 및 IP 설계기법/
Detailed Information
- Material Type
- 단행본
- ISBN
- 89-7283-398-3
- UDC
- 621.382
- DDC
- 621.38152 강18H-23
- Callnumber
- 621.38152 강18H
- Author
- 강성호, 김대정, 이승준, 이찬호
- Title/Author
- (HDL을 이용한) SoC 및 IP 설계기법/ 강성호, 김대정, 이승준, 이찬호 공저
- Publish Info
- 서울: : 홍릉과학출판사,, 2004
- Material Info
- 271p.: : 삽도; ; 27cm
- General Note
- SoC는 'System-on-Chip'임.
- Formatted Contents Note
- 완전내용1장 서론부분내용1완전내용1.1 SoC 설계 및 설계 재사용부분내용3완전내용1.2 가이드라인의 필요성부분내용5완전내용1.3 SoC 설계 활성화를 위한 노력부분내용9완전내용2장 SoC 설계 방법론부분내용15완전내용2.1 설계 흐름부분내용18완전내용2.2 타이밍과 합성에 관련된 설계시 고려할 점부분내용26완전내용2.3 기능적인 설계에서 고려할 점부분내용30완전내용2.4 물리적 설계에서 고려할 점부분내용33완전내용2.5 설계 검증시 고려할 점부분내용4000완전내용2.6 Test issues부분내용5411완전내용3장 Verilog Coding Style Guide부분내용6522완전내용3.1 File Header부분내용6533완전내용3.2 Coding for Readability부분내용6744완전내용3.3 Coding for Portability부분내용8855완전내용3.4 Guideline for Clocks and Resets부분내용9766완전내용3.5 Coding for Synthesis부분내용10277완전내용4장 VHDL Coding Style Guide부분내용16388완전내용4.1 File Header부분내용16399완전내용4.2 Coding for readability부분내용16500완전내용4.3 Coding for portability부분내용18811완전내용4.4 Guideline for clocks and resets부분내용20022완전내용4.5 Coding for Synthesis부분내용20433완전내용찾아보기부분내용27144
- Price Info
- ￦19000
- Control Number
- gtec:11602
MARC
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■500 ▼aSoC는 'System-on-Chip'임.
■505 ▼a1장 서론▼c1▼a1.1 SoC 설계 및 설계 재사용▼c3▼a1.2 가이드라인의 필요성▼c5▼a1.3 SoC 설계 활성화를 위한 노력▼c9▼a2장 SoC 설계 방법론▼c15▼a2.1 설계 흐름▼c18▼a2.2 타이밍과 합성에 관련된 설계시 고려할 점▼c26▼a2.3 기능적인 설계에서 고려할 점▼c30▼a2.4 물리적 설계에서 고려할 점▼c33▼a2.5 설계 검증시 고려할 점▼c4000▼a2.6 Test issues▼c5411▼a3장 Verilog Coding Style Guide▼c6522▼a3.1 File Header▼c6533▼a3.2 Coding for Readability▼c6744▼a3.3 Coding for Portability▼c8855▼a3.4 Guideline for Clocks and Resets▼c9766▼a3.5 Coding for Synthesis▼c10277▼a4장 VHDL Coding Style Guide▼c16388▼a4.1 File Header▼c16399▼a4.2 Coding for readability▼c16500▼a4.3 Coding for portability▼c18811▼a4.4 Guideline for clocks and resets▼c20022▼a4.5 Coding for Synthesis▼c20433▼a찾아보기▼c27144
■9500 ▼b￦19000
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